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模数转换器(ADC)之前的模拟前端(AFE)进行复杂的滤波处理

发布时间:2022/11/21 13:08:25 访问次数:1125

传统的工业数据采集设计通常需要对模数转换器(ADC)之前的模拟前端(AFE)进行复杂的滤波处理。模拟滤波器的主要目的是衰减不需要的带外信号,进而防止这类信号在所需的目标信号上发生混叠,因此,模拟滤波器又称为抗混叠滤波器(AAF)。

混叠频段中不需要的信号和噪声可能源自驱动放大器、电源切换引入的杂散,甚至是意外的干扰因素(干扰器)。

混叠频率大小直接取决于ADC采样速率,数据转换器在给定瞬时带宽下的工作速度越快,混叠频段距离所需的信号就越远,越容易进行滤波处理。根据这一现象,在精度非常高的系统中,设计人员通常使用具有高过采样率和抽取滤波器的Σ-Δ ADC。

EFLX是一种用于开发嵌入式FPGA的数字架构,可集成到任意尺寸的SoC、ASIC和MCU中。 EFLX4K Logic IP内核具有4K个等效4输入LUT、632个输入和632个输出,是一个完整的eFPGA。 EFLX4K DSP IP内核用40个乘法累加器替换了大约1/4的LUT,用于DSP和人工智能(AI)应用。 

两个EFLX4K内核可以平铺在一起以形成更大的阵列,支持需要更多LUT的应用程序(最高支持超过250,00个LUT以及任意混合的逻辑和DSP内核)。

EFLX阵列使用Verilog或VHDL进行编程,EFLX Compiler采用Synopsys Synplify等综合工具的输出,进行布局、布线、时序和比特流生成。 比特流在加载到阵列中时,将对其进行编程并执行所需的RTL。

4GB耐辐射DDR4T04G72是一款包含5个裸片的MCP,其中4个分别提供 1GB(8Gb)的存储(512Mb x 16 位),组成2组,每组有4个bank

为了提高可靠性,它使用72位的数据总线,包含64位数据和8位错误检测修复。

这个ECC功能在第5片裸片中实现。该器件使用一个内部的8n预取缓冲以最大限度地高速运行,并提供可编程的读、写和附加延迟。

POD的I/O降低了驱动数据时的开关电流,因为只有0时才消耗功率。DDR4还提供数据总线倒置,以分配更少的位,降低热量和功耗。通过减少开关的次数,可减少噪声,并实现更干净的数据眼图。

来源:eefocus.如涉版权请联系删除。图片供参考

传统的工业数据采集设计通常需要对模数转换器(ADC)之前的模拟前端(AFE)进行复杂的滤波处理。模拟滤波器的主要目的是衰减不需要的带外信号,进而防止这类信号在所需的目标信号上发生混叠,因此,模拟滤波器又称为抗混叠滤波器(AAF)。

混叠频段中不需要的信号和噪声可能源自驱动放大器、电源切换引入的杂散,甚至是意外的干扰因素(干扰器)。

混叠频率大小直接取决于ADC采样速率,数据转换器在给定瞬时带宽下的工作速度越快,混叠频段距离所需的信号就越远,越容易进行滤波处理。根据这一现象,在精度非常高的系统中,设计人员通常使用具有高过采样率和抽取滤波器的Σ-Δ ADC。

EFLX是一种用于开发嵌入式FPGA的数字架构,可集成到任意尺寸的SoC、ASIC和MCU中。 EFLX4K Logic IP内核具有4K个等效4输入LUT、632个输入和632个输出,是一个完整的eFPGA。 EFLX4K DSP IP内核用40个乘法累加器替换了大约1/4的LUT,用于DSP和人工智能(AI)应用。 

两个EFLX4K内核可以平铺在一起以形成更大的阵列,支持需要更多LUT的应用程序(最高支持超过250,00个LUT以及任意混合的逻辑和DSP内核)。

EFLX阵列使用Verilog或VHDL进行编程,EFLX Compiler采用Synopsys Synplify等综合工具的输出,进行布局、布线、时序和比特流生成。 比特流在加载到阵列中时,将对其进行编程并执行所需的RTL。

4GB耐辐射DDR4T04G72是一款包含5个裸片的MCP,其中4个分别提供 1GB(8Gb)的存储(512Mb x 16 位),组成2组,每组有4个bank

为了提高可靠性,它使用72位的数据总线,包含64位数据和8位错误检测修复。

这个ECC功能在第5片裸片中实现。该器件使用一个内部的8n预取缓冲以最大限度地高速运行,并提供可编程的读、写和附加延迟。

POD的I/O降低了驱动数据时的开关电流,因为只有0时才消耗功率。DDR4还提供数据总线倒置,以分配更少的位,降低热量和功耗。通过减少开关的次数,可减少噪声,并实现更干净的数据眼图。

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