前言

随着通信技术的发展，标准化的基带-射频接口越来越受到各厂家的关注，在近几年内相继出现了cpri、obsai、tdri接口标准。cpri作为通用开放接口标准，由于其实现上的经济简便性受到了多方厂家的支持，设备供应商相继推出了基于crpi协议标准的拉远产品，另一方面基于crpi协议的交换机和路由器也在逐渐的成熟和推广。开放的通用接口为3g基站产品节约成本、提高通用性和灵活性提供了方便。

cpri协议由爱立信、华为、nec、北电和西门子五个厂家联合发起制定，用于无线通讯基站中基带到射频之间的通用接口协议，对其它组织和厂家开放。cpri大部分内容主要针对wcdma标准，为其可实现良好服务。经分析，cpri协议同样适用于td-scdma第三代移动通讯标准。cpri协议横向分为物理层和数据链路层；纵向分为用户平面、控制管理平面和同步平面，具有图1所示的结构。

硬件构架与实现

cpri协议分析仪主要实现射频单元、基带单元的功能模拟。一方面采集数据进行协议分析，另一方面则产生模拟数据进行协议发送。基于图1的协议结构，分析仪由控制器、cpri协议处理器、时钟处理以及对外接口四个主要功能单元构成，支持614.4mbps、1.2288gbps和2.4576gbps三种数据速率，原理框图如图2示。

协议分析仪上高速信号较多，单组总线宽达64位，时钟速率66.6mhz，差分线对速率2.5gbps。对于宽数据总线和快时钟速率，信号集成设计至关重要，一方面要保证每一个关键信号的信号完整性，同时在时序上需要满足接收芯片对于信号采样点的需求，以保证稳定无误的采样。本设计中采用了cadence提供的sigxplorer仿真设计工具，以ibis作为仿真模型，对关键信号进行了预仿真和布线后仿真，同时对关键链路进行了严格的时序裕度计算。文章限于篇幅，以部分关键链路和关键信号的设计为例来展开，其他内容在此不再赘述。

差分信号的端接和匹配

cpri分析仪板卡上存在lvds、cml和lvpecl等多种差分电平，不同电平之间的互连需要精心地设计他们之间的匹配和端接，以实现稳定可靠的工作。lvpecl到lvds之间采用dc耦合，图3和图4显示了61.44mhz时钟在这种设计下的参数和仿真结果。

时序计算分析

所有的同步时序单沿采样分析建立在如下两个时序闭环公式的基础上：

公式:

公式中各参数的含义及其来源可参考下表:
tswitch 和t flight 参数是唯一通过仿真来得到的参数，其准确性依赖于对ibis模型的正确使用，cadence仿真工具sigxplorer可以直接生成仿 真结果参数报表，比较方便。需要注意的是，驱动管脚的bufferdelay参数需要处理好，否则可能引起这一参数在时序裕度计算过程中重复参与，表1至表6是主控器与外设之间的时序裕度计算过程和结果。
仿真计算结果显示，sdram采样保持时间不足，在实际操作中，将mcp的时钟相位相对 sdram时钟的相位滞后0.6ns解决问题。

实际信号测试

控制信号的实测眼图及其与采样时钟的相位关系见图5、图6。

前言 随着通信技术的发展，标准化的基带-射频接口越来越受到各厂家的关注，在近几年内相继出现了cpri、obsai、tdri接口标准。cpri作为通用开放接口标准，由于其实现上的经济简便性受到了多方厂家的支持，设备供应商相继推出了基于crpi协议标准的拉远产品，另一方面基于crpi协议的交换机和路由器也在逐渐的成熟和推广。开放的通用接口为3g基站产品节约成本、提高通用性和灵活性提供了方便。 cpri协议由爱立信、华为、nec、北电和西门子五个厂家联合发起制定，用于无线通讯基站中基带到射频之间的通用接口协议，对其它组织和厂家开放。cpri大部分内容主要针对wcdma标准，为其可实现良好服务。经分析，cpri协议同样适用于td-scdma第三代移动通讯标准。cpri协议横向分为物理层和数据链路层；纵向分为用户平面、控制管理平面和同步平面，具有图1所示的结构。 硬件构架与实现 cpri协议分析仪主要实现射频单元、基带单元的功能模拟。一方面采集数据进行协议分析，另一方面则产生模拟数据进行协议发送。基于图1的协议结构，分析仪由控制器、cpri协议处理器、时钟处理以及对外接口四个主要功能单元构成，支持614.4mbps、1.2288gbps和2.4576gbps三种数据速率，原理框图如图2示。 协议分析仪上高速信号较多，单组总线宽达64位，时钟速率66.6mhz，差分线对速率2.5gbps。对于宽数据总线和快时钟速率，信号集成设计至关重要，一方面要保证每一个关键信号的信号完整性，同时在时序上需要满足接收芯片对于信号采样点的需求，以保证稳定无误的采样。本设计中采用了cadence提供的sigxplorer仿真设计工具，以ibis作为仿真模型，对关键信号进行了预仿真和布线后仿真，同时对关键链路进行了严格的时序裕度计算。文章限于篇幅，以部分关键链路和关键信号的设计为例来展开，其他内容在此不再赘述。 差分信号的端接和匹配 cpri分析仪板卡上存在lvds、cml和lvpecl等多种差分电平，不同电平之间的互连需要精心地设计他们之间的匹配和端接，以实现稳定可靠的工作。lvpecl到lvds之间采用dc耦合，图3和图4显示了61.44mhz时钟在这种设计下的参数和仿真结果。 时序计算分析 所有的同步时序单沿采样分析建立在如下两个时序闭环公式的基础上： 公式: 公式中各参数的含义及其来源可参考下表: tswitch 和t flight 参数是唯一通过仿真来得到的参数，其准确性依赖于对ibis模型的正确使用，cadence仿真工具sigxplorer可以直接生成仿 真结果参数报表，比较方便。需要注意的是，驱动管脚的bufferdelay参数需要处理好，否则可能引起这一参数在时序裕度计算过程中重复参与，表1至表6是主控器与外设之间的时序裕度计算过程和结果。 仿真计算结果显示，sdram采样保持时间不足，在实际操作中，将mcp的时钟相位相对 sdram时钟的相位滞后0.6ns解决问题。 实际信号测试 控制信号的实测眼图及其与采样时钟的相位关系见图5、图6。 上一篇：自组织跳频组网网络同步技术研究 上一篇：协同设计技术 相关技术资料 6-25​GPU、CPU、FPGA、DSP和ADC优特点及应用区别 6-25​全球首款超低功耗60G毫米波雷达SoC芯片系列 6-25​全新Robotaxi App应用前景分析 6-25​3nm GAA工艺Exynos 2500芯片探究 6-25​FOWLP（扇出型晶圆级封装）参数技术封装分析 6-25三星Exynos 2500芯片应用解读 6-24​NE555定时器运动探测器工作原理 6-24​高速和精密DAC应用解决方案详解 6-24​安全嵌入式系统数字控制器应用前景探究 6-24​双测量空气流量传感器技术参数封装 6-24高速、低功耗3D芯片集成技术详解 6-24​开源GSM + GPS模块原理图和PCB设计 相关IC型号 热门点击 彩电屡烧行管的几点问题讨论 真空断路器的合闸弹跳与分闸弹振研究 电子罗盘 Actel面向FPGA设计的新版IDE支持添 PPP协议链路操作的软件实现 FCS在大容量涤纶短纤纺丝生产线中的应用 TI推出单芯片交错式功率因数校正控制电路UC C51中的关键字 静态时序分析中的门延时计算 USB1.1和USB2.0相关标准   推荐技术资料 罗盘误差及补偿     造成罗盘误差的主要因素有传感器误差、其他磁材料干扰等。... [详细] ​GPU、CPU、FPGA、DS ​全球首款超低功耗60G毫米波雷 ​全新Robotaxi App应 ​3nm GAA工艺Exynos ​FOWLP（扇出型晶圆级封装） 三星Exynos 2500芯片应用解读 多媒体协处理器SM501在嵌入式系统中的应用 基于IEEE802.11b的EPA温度变送器 QUICCEngine新引擎推动IP网络革新 SoC面世八年后的产业机遇 MPC8xx系列处理器的嵌入式系统电源设计 dsPIC及其在交流变频调速中的应用研究 版权所有:51dzw.COM 深圳服务热线：13692101218  13751165337 粤ICP备09112631号-6(miitbeian.gov.cn) 公网安备44030402000607 深圳市碧威特网络技术有限公司 付款方式 把51电子网设为首页      把51电子网加入收藏夹      给51电子网投诉建议 关于我们| 会员收费标准| 广告服务| 招贤纳士| 付款方式| 友情链接| 网站地图| 联系我们| 免责声明| 库存上载：service@51dzw.com 　　 版权所有:51dzw.COM 粤ICP备09112631号-6(miitbeian.gov.cn) 服务热线(深圳)：13751165337 13692101218 传真：0755-83035052 投诉电话:0755-83030533  复制成功！