ISL6140可编程乘积项阵列
发布时间:2019/10/24 12:28:05 访问次数:604
ISL6140当ui1<2vcc/3,ui2>vcc/3时,简单SR锁存器R=1,s=1,锁存器状态不变,电路保持原状态不变。
电路功能,综合上述分析,可得555定时器功能表,如表8.4.1所示。
将555定时器的阈值输人端和触发输人端相接 ,即构成施密特触发器 ,电路和简化电路分别如图8.4.2(a)，(b)所示．
可编程乘积项阵列，乘积项阵列有4个输入,可以产生而变量的乘积项。一般一个宏单元对应5个乘积项,这样,在逻辑块中共有5×屁个乘积项。例如,XC9500系列的逻辑块中有90个36变量乘积项,MAX7000系列的逻辑块中有80个36变量乘积项。
乘积项分配和宏单元，不同型号的CPLD器件,乘积项分配和宏单元电路结构也不完全相同,但所要实现的功能大体相似。图7.3.3所示为XC9500系列的乘积项分配和宏单元电路。图中S1~S:为可编程数据分配器,M1~M5为可编程数据选择器。为简明起见,没有画出它们的可编程选择输入端。到上一个宏单元来自上一个宏单元全局置位局复位乘积项配电路全局时钟3部程区内编线到可连
oyr项输出使能PrOE要I/o单元来自下一个宏单元 到下一个宏单元．
来自可编程乘积项阵列的5个乘积项,通过数据分配器S1~S5送至宏单元的主或门G4构成与一或式。与此同时,或门G4最上端的输人,可以通过数据分配器S6、S7和或门G3,取自上一个相邻宏单元的乘积项或下一个相邻宏单元的乘积项,从而扩展了乘积项的个数。
宏单元中任何没有用到的乘积项,都可以经过或门Gl与经S6和S7来自相邻宏单元的乘积项由或门G2组合在一起,再经过数据分配器S:送到上一个存储器、复杂可编程器件和现场可编程门阵列．
ISL6140当ui1<2vcc/3,ui2>vcc/3时,简单SR锁存器R=1,s=1,锁存器状态不变,电路保持原状态不变。
电路功能,综合上述分析,可得555定时器功能表,如表8.4.1所示。
将555定时器的阈值输人端和触发输人端相接 ,即构成施密特触发器 ,电路和简化电路分别如图8.4.2(a)，(b)所示．
可编程乘积项阵列，乘积项阵列有4个输入,可以产生而变量的乘积项。一般一个宏单元对应5个乘积项,这样,在逻辑块中共有5×屁个乘积项。例如,XC9500系列的逻辑块中有90个36变量乘积项,MAX7000系列的逻辑块中有80个36变量乘积项。
乘积项分配和宏单元，不同型号的CPLD器件,乘积项分配和宏单元电路结构也不完全相同,但所要实现的功能大体相似。图7.3.3所示为XC9500系列的乘积项分配和宏单元电路。图中S1~S:为可编程数据分配器,M1~M5为可编程数据选择器。为简明起见,没有画出它们的可编程选择输入端。到上一个宏单元来自上一个宏单元全局置位局复位乘积项配电路全局时钟3部程区内编线到可连
oyr项输出使能PrOE要I/o单元来自下一个宏单元 到下一个宏单元．
来自可编程乘积项阵列的5个乘积项,通过数据分配器S1~S5送至宏单元的主或门G4构成与一或式。与此同时,或门G4最上端的输人,可以通过数据分配器S6、S7和或门G3,取自上一个相邻宏单元的乘积项或下一个相邻宏单元的乘积项,从而扩展了乘积项的个数。
宏单元中任何没有用到的乘积项,都可以经过或门Gl与经S6和S7来自相邻宏单元的乘积项由或门G2组合在一起,再经过数据分配器S:送到上一个存储器、复杂可编程器件和现场可编程门阵列．
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