DDS芯片AD9832的原理及应用
发布时间:2008/5/27 0:00:00 访问次数:698
     江玉蓉 周有庆 吴桂清
    
     来源:《国外电子元器件》
     摘要:ad9832是ad公司生产的直接数字频率合成器。它体积小、重量轻、操作方便,同时具有极高的频率辩率。文章介绍了直接数字频率合成器(dds)ad9832的原理,分析了aad9832的内部结构、引脚功能以及在高频测试仪中的应用。
    
    
     关键词:直接数字频率合成器
     dds ad9832 高频测试仪
     直接数字频率合成是一种新的频率合成技术和信号产生方法。直接数字频率合成器(dds)具有超高速的频率转换时间,极高的频率分辨率和较低的相位噪声,在频率改变与调频时,dds器件能够保持相位的连续,因此很容易实现频率、相位和幅度调制。此外,该器件还具有可编程控制的突出优点。因此,直接数字频率合成器得到了越来越广泛的应用,成为当今电子系统及设备中频率源的首选器件。
     1 dds的基本原理
     dds的原理框图如图1所示。图中相位累加器可在每一个时钟周期来临时将频率控制码所决定的相位增量δphase累加一次,如果记数大于2n,则自动溢出,而只保留后面的n位数字于累加器中。正弦查询表rom用于实现从相位累加器输出的相位值到正弦幅度值的转换,并根据输入到正弦查询表rom的相位值取出rom中与其对应的数字量,然后送到dac中将其转变为模拟量,最后通过滤波器输出一个很纯的正弦波信号。
     其输出频率fout与时钟频率fclk及频率控制码决定的相位增量δphase有关。可用下式算出:
     fout=(δphase/2n)fclk
     式中,n是相位累加器的比特数。根据采样定理,dds的最高输出频率应小于fclk/2,而实际只能达到40%fclk。
     dds的最小频率分辨率可由下式给出:
     δfmin=fclk/2n
     因此,只要n足够大,即累加器的位数具有足够的长度,以能得以所需的频率分辨率。
     2 ad9832芯片介绍
     2.1 ad9832的内部结构
     ad9832是ad公司生产的一款完整的dds芯片,它的最高时钟频率可达25mhz。其内部的功能结构图如图2所示。ad9832主要由数控振荡器(nco)和相位调制器、正弦查询表以及一个10位数模转换器(dac)组成。其中数控振荡器和相位调制器部分包含两个32位的频率寄存器、一个32位的相位累加器和四个12位的相位寄存器。
     2.2 ad9832的引脚功能
    
    
    
    
    
     ad9832的主要端口分为数据及控制端口、电源端口以及参考和输出信号端口几部分。这些端口引脚的功能如下:
     mclk:数字时钟输入端,该时钟决定了dds的输出频率精度和相位噪声。
     sclk:串行时钟信号,数据在sclk的每一个下降沿写入ad9832。
     sdata:16位串行数据输入端。
     fsync:数据同步信号输入端,当它为低电平时,表示正在输入一个新字。
    
    
    
    
    
     fselect:频率选择控制器。ad9832有两个频率寄存器freq0和freq1。当fselect=0时,选择freq0;当fselect=1时,选择freq1。可以使用管脚fselect或位fselect来控制选择使用哪一个寄存器,当使用位fselect进行选择时,管脚fselect
     江玉蓉 周有庆 吴桂清
    
     来源:《国外电子元器件》
     摘要:ad9832是ad公司生产的直接数字频率合成器。它体积小、重量轻、操作方便,同时具有极高的频率辩率。文章介绍了直接数字频率合成器(dds)ad9832的原理,分析了aad9832的内部结构、引脚功能以及在高频测试仪中的应用。
    
    
     关键词:直接数字频率合成器
     dds ad9832 高频测试仪
     直接数字频率合成是一种新的频率合成技术和信号产生方法。直接数字频率合成器(dds)具有超高速的频率转换时间,极高的频率分辨率和较低的相位噪声,在频率改变与调频时,dds器件能够保持相位的连续,因此很容易实现频率、相位和幅度调制。此外,该器件还具有可编程控制的突出优点。因此,直接数字频率合成器得到了越来越广泛的应用,成为当今电子系统及设备中频率源的首选器件。
     1 dds的基本原理
     dds的原理框图如图1所示。图中相位累加器可在每一个时钟周期来临时将频率控制码所决定的相位增量δphase累加一次,如果记数大于2n,则自动溢出,而只保留后面的n位数字于累加器中。正弦查询表rom用于实现从相位累加器输出的相位值到正弦幅度值的转换,并根据输入到正弦查询表rom的相位值取出rom中与其对应的数字量,然后送到dac中将其转变为模拟量,最后通过滤波器输出一个很纯的正弦波信号。
     其输出频率fout与时钟频率fclk及频率控制码决定的相位增量δphase有关。可用下式算出:
     fout=(δphase/2n)fclk
     式中,n是相位累加器的比特数。根据采样定理,dds的最高输出频率应小于fclk/2,而实际只能达到40%fclk。
     dds的最小频率分辨率可由下式给出:
     δfmin=fclk/2n
     因此,只要n足够大,即累加器的位数具有足够的长度,以能得以所需的频率分辨率。
     2 ad9832芯片介绍
     2.1 ad9832的内部结构
     ad9832是ad公司生产的一款完整的dds芯片,它的最高时钟频率可达25mhz。其内部的功能结构图如图2所示。ad9832主要由数控振荡器(nco)和相位调制器、正弦查询表以及一个10位数模转换器(dac)组成。其中数控振荡器和相位调制器部分包含两个32位的频率寄存器、一个32位的相位累加器和四个12位的相位寄存器。
     2.2 ad9832的引脚功能
    
    
    
    
    
     ad9832的主要端口分为数据及控制端口、电源端口以及参考和输出信号端口几部分。这些端口引脚的功能如下:
     mclk:数字时钟输入端,该时钟决定了dds的输出频率精度和相位噪声。
     sclk:串行时钟信号,数据在sclk的每一个下降沿写入ad9832。
     sdata:16位串行数据输入端。
     fsync:数据同步信号输入端,当它为低电平时,表示正在输入一个新字。
    
    
    
    
    
     fselect:频率选择控制器。ad9832有两个频率寄存器freq0和freq1。当fselect=0时,选择freq0;当fselect=1时,选择freq1。可以使用管脚fselect或位fselect来控制选择使用哪一个寄存器,当使用位fselect进行选择时,管脚fselect
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