由于使用CML驱动器采用的接口通常是串行接口，引脚数的增加与CMOS或LVDS相比要少得多（在CMOS或LVDS中传输的数据是并行数据，需要的引脚数多得多）。

CML驱动器用于串行数据接口，因此，所需引脚数要少得多。为用于具有JESD204接口或类似数据输出的转换器的典型CML驱动器。显示了CML驱动器典型架构的一般情况。其显示可选源终端电阻和共模电压。电路的输入可将开关驱动至电流源，电流源则将适当的逻辑值驱动至两个输出端。

典型CML输出驱动器,CML驱动器类似于LVDS驱动器，以恒定电流模式工作。这也使得CML驱动器在功耗方面具备一定优势。在恒定电流模式下工作需要较少的输出引脚，总功耗会降低。与LVDS一样，CML也需要负载端接、单端阻抗为50 Ω的受控阻抗传输线路，以及100 Ω的差分阻抗。驱动器本身也可能具有端接，对因高带宽信号灵敏度引起的信号反射有所帮助。

对采用JESD204标准的转换器而言，差分和共模电平均存在不同规格，具体取决于工作速度。工作速度高达6.375 Gbps，差分电平标称值为800 mV，共模电平约为1.0 V。在高于6.375 Gbps且低于12.5 Gbps的速度下工作时，差分电平额定值为400 mV，共模电平仍约为1.0 V。

随着转换器速度和分辨率增加，CML输出需要合适类型的驱动器提供必要速度，以满足各种应用中转换器的技术需求。

每种数字输出驱动器都有时序关系，需要密切监控。由于CMOS和LVDS有多种数据输出，因此必须注意信号的路由路径，以尽量减小偏斜。如果差别过大，可能就无法在接收器上实现合适的时序。

时钟信号也需要通过路由传输，并与数据输出保持一致。时钟输出和数据输出之间的路由路径也必须格外注意，以确保偏斜不会太大。

在切换逻辑状态时不太可能会出现问题。如果有许多CMOS驱动器同时切换，电源电压可能会下降，将正确的逻辑值驱动到接收器时会出现问题。LVDS驱动器会保持在恒定电流水平，这一特别问题就不会发生。此外，由于采用了差分信号，LVDS驱动器本身对共模噪声的耐受能力也较强。CML驱动器具有和LVDS同样的优势。这些驱动器也有恒定水平的电流，但和LVDS不同的是，由于数据为串行，所需电流值较小。由于也采用了差分信号，CML驱动器同样对共模噪声具有良好的耐受能力。

随着转换器技术的发展，速度和分辨率不断增加，数字输出驱动器也不断演变发展，以满足数据传输需求。随着转换器中的数字输出接口转换为串行数据传输，CML输出越来越普及。目前的设计中仍然会用到CMOS和LVDS数字输出。每种数字输出都有最适合的应用。每种输出都面临着挑战，必须考虑到一些设计问题，且各有所长。在采样速度小于200 Msps的转换器中，CMOS仍然是一种合适的技术。

当采样速率增加到200 MSPS以上时，与CMOS相比，LVDS在许多应用中更加可行。为了进一步增加效率、降低功耗、减小封装尺寸，CML驱动器可与JESD204之类的串行数据接口配合使用。