Verilog HDL 的书写格式
发布时间:2008/6/5 0:00:00 访问次数:638
4.3 格式
verilog hdl 是区分大小写的，即大小写不同的标识符是不同的。
另外verilog hdl 的书写格式是自由的，即一条语句可多行书写；一行可写多个语句。
白空（新行、制表符、空格）没有特殊意义。
如 input a；input b；与
input a；
input b；
是一样的。
书写规范建议：
一个语句一行。
采用空四格的table 键进行缩进。
verilog hdl 是区分大小写的，即大小写不同的标识符是不同的。
另外verilog hdl 的书写格式是自由的，即一条语句可多行书写；一行可写多个语句。
白空（新行、制表符、空格）没有特殊意义。
如 input a；input b；与
input a；
input b；
是一样的。
书写规范建议：
一个语句一行。
采用空四格的table 键进行缩进。
4.3 格式
verilog hdl 是区分大小写的，即大小写不同的标识符是不同的。
另外verilog hdl 的书写格式是自由的，即一条语句可多行书写；一行可写多个语句。
白空（新行、制表符、空格）没有特殊意义。
如 input a；input b；与
input a；
input b；
是一样的。
书写规范建议：
一个语句一行。
采用空四格的table 键进行缩进。
verilog hdl 是区分大小写的，即大小写不同的标识符是不同的。
另外verilog hdl 的书写格式是自由的，即一条语句可多行书写；一行可写多个语句。
白空（新行、制表符、空格）没有特殊意义。
如 input a；input b；与
input a；
input b；
是一样的。
书写规范建议：
一个语句一行。
采用空四格的table 键进行缩进。
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