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Verilog HDL发展历史

发布时间:2008/6/5 0:00:00 访问次数:906

verilog hdl 语言最初是于1983 年由gateway design automation 公司为其模拟器产品开发的硬
件建模语言。那时它只是一种专用语言。由于他们的模拟、仿真器产品的广泛使用,verilog hdl
作为一种便于使用且实用的语言逐渐为众多设计者所接受。在一次努力增加语言普及性的活动
中,verilog hdl 语言于1990 年被推向公众领域。open verilog international(o v i )是促进
verilog 发展的国际性组织。1992 年,ovi 决定致力于推广verilog ovi 标准成为ieee 标准。这一
努力最后获得成功,verilog 语言于1995 年成为ieee 标准,称为ieee std1364-1995 。完整的标
准在verilog 硬件描述语言参考手册中有详细描述。


verilog hdl 语言最初是于1983 年由gateway design automation 公司为其模拟器产品开发的硬
件建模语言。那时它只是一种专用语言。由于他们的模拟、仿真器产品的广泛使用,verilog hdl
作为一种便于使用且实用的语言逐渐为众多设计者所接受。在一次努力增加语言普及性的活动
中,verilog hdl 语言于1990 年被推向公众领域。open verilog international(o v i )是促进
verilog 发展的国际性组织。1992 年,ovi 决定致力于推广verilog ovi 标准成为ieee 标准。这一
努力最后获得成功,verilog 语言于1995 年成为ieee 标准,称为ieee std1364-1995 。完整的标
准在verilog 硬件描述语言参考手册中有详细描述。


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