1 引 言

近几年来，随着低价位dsp芯片的出现，他已被广泛应用到控制与测量领域中。国内的dsp芯片以ti公司的tms320系列为主流。这种微处理器对外的数据和地址总线结构形式为非多路复用方式，不能与多路复用形式的外围接口芯片(如can控制器sja1000)直接相连。国内、外也没有一款专用集成芯片来实现非多路复用方式到多路复用方式的转换。

文献[1]提出了一种转换方法，是将dsp的数据线作为can控制器的数据地址复用线，用dsp的地址线a0作为地址、数据选择线。a0=1时，地址有效；a0=0时，数据有效，即用奇数地址传送地址，用偶数地址传送数据。虽然此方法实现起来电路简单，但在编程时，程序员必须考虑发送的数据何时作为can控制器的地址，何时作为can控制器的数据，没有从根本解决非多路复用方式到多路复用方式的转换。

本文以tms320f206与sjal000连接为例，提出采甩复杂可编程逻辑器件cpld，完全用硬件实现非多路复用方式到多路复用方式的转换。

2 多路复用总线的信号和时序

2．1 sjal000接口的主要信号说明

can控制器sjal000提供的微处理器接口方式为典型intel或motorola地址数据多路复用总线模式，主要信号有地址数据信号ad7～ad0，地址选通信号ale，片选信号cs，读信号rd，写信号wr，模式选择信号mode。当mode=1时，为intel模式；当mode=0时，为motorola模式。后面描述的地址数据多路复用总线模式均为intel模式。

图1，图2分别为intel模式读、写周期时序[2]。ad7～ad0引脚在ale有效时，传送的是地址信号，在rd或wr有效时，传输的是数据信号。

2．2 sjal000时序分析

以sjal000的读时序(图1)为例，说明在设计转换桥时，多路复总线的各信号必须满足时间参数要求。ale的脉冲宽度tw(al)最小为8 ns；地址信号(a7～a0)建立到ale变为低电平所需时间tsu(a-al)最小为8 ns；rd的有效脉宽tw(r)最小为40 ns；rd为低电平到数据信号(d7～d0)有效所需时间trlqv最大为50 ns；rd变为高电平到地址数据线释放(即高阻状态)所需时间(trhdz)最大为30 ns。

3非多路复用总线的信号和时序

3．1 tsm320f206总线主要信号说明

tsm320f206的总线接口方式采用了地址和数据分离的形式。其主要信号有地址信号a0～a15，数据信号do～d15，读信号re，写信号we，闸门信号strb，i/o空间选择信号is，数据存储器选择信号ds，程序存储器选择信号ps，机器时钟输出信号clkout1。当对外部数据存储器、程序存储器或i/o空间访问时，strb有效，若对外部i/o访问时(即程序中使用portr，portw指令)，is有效。

3．2 tsm320f206的i/o时序分析

tms320f206的读写时序[2]如图3和图4所示。i/o的读或写工作周期一般在两个机器周期内完成，在此期间，is信号地址信号一直保持有效；闸门信号strb发生在第一个机器周期有效后并保持一个机器周期以上；re和we有效时，数据有效。在两次连续的写操作(如图4所示)，we的有效间隔时间tw(wh)最小为(2h-4)ns，而两次连续的读访问(如图3所示)，re的有效间隔时间tw(rdh)为(h-4)ns-h ns，其中h为0．5倍的机器时钟周期，可见连续的读、写操作时，re，we的有效间隔不同，在设计电路时，应注意此细节。在连续的读或写操作时，is信号一直为有效电平'0'，无法以此信号作为产生sjal000的ale、读、写信号起始基准，而在写周期时，strb与we的变化始终保持一致，因此在产生sjal000写周期时，可以用strb作为ale、写信号wr产生的起始基准信号。但是tsm320f206在连续的读操作时，strb一直保持为低电平，可见在产生sjal000读、写操作周期时，无法单独以他作为ale，rd信号产生的起始基准，需与is，we，re进行逻辑组合作为sjal000读、写操作周期的起始基准
信号。

4 cpld实现转换桥设计方法

此转换桥如果用中规模集成电路(74系列)实现比较
复杂，工作频率又较高，布线时稍不合理，易引起干扰，使
得电路工作不稳定，因此采用高可靠性的复杂可编程逻辑
器件cpld，用硬件描述语言vhdl来实现。

4．1转换桥引脚信号定义

图5为转换桥的时序仿真结果，其中转换桥的各引脚信号与tms320f206和sjal0001引脚信号对应为：fabl7接a0～a7；fdb7接do～d7；fds接is；fstrb接strb；fwe接we；frd接re；fcp接clkout1；